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TLV3501AIDR 1.速延遲時(shí)間為 4.5ns 2.傳播延遲和操作 + 2.7V 至+5.5V，由于超出擺幅輸入共模范圍使其非常適合低電壓應(yīng)用的理想選擇。 3.?軌對(duì)軌輸出可直接驅(qū)動(dòng) CMOS 或 TTL 邏輯。 4.TLV3501提供 SOT23-6 和 SO-8 封裝。? ? |
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